基于JP5028G芯片的2048kbit/s接口电路设计与验证

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设计与应用 | 更新时间：2026-07-10

- 基于JP5028G芯片的2048kbit/s接口电路设计与验证
- 基于JP5028G芯片的2048kbit/s接口电路设计与验证
- 现代传输 2022年第4期页码：30-34
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  中图分类号： TN40;TN702
- 纸质出版：2022
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尹茳, 吴阳, 李庆一, 等. 基于JP5028G芯片的2048kbit/s接口电路设计与验证[J]. 现代传输, 2022,(4):30-34.

尹茳, 吴阳, 李庆一, et al. 基于JP5028G芯片的2048kbit/s接口电路设计与验证[J]. 2022, (4): 30-34.
尹茳, 吴阳, 李庆一, 等. 基于JP5028G芯片的2048kbit/s接口电路设计与验证[J]. 现代传输, 2022,(4):30-34. DOI：

尹茳, 吴阳, 李庆一, et al. 基于JP5028G芯片的2048kbit/s接口电路设计与验证[J]. 2022, (4): 30-34. DOI：

2048kbit/s接口是通信网中传输网、接入网、同步网的主要数据或定时接口。传统的接口芯片主要实现NRZ码和HDB3编码之间的编解码。本文利用国产JP5028G芯片进行了E1定时电路设计并进行了验证。

GB/T 7611-2016. 数字网系列比特率电接口特性 [S]. 2016

GB/T 13997-1999. 2048kbit/s、8448kbit/s、34368kbit/s、139264kbit/s光端机技术要求 [S]. 1999

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