动态可重构阵列处理器数据流处理单元的设计与实现

山蕊; 李涛; 蒋林

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动态可重构阵列处理器数据流处理单元的设计与实现

更新时间：2026-09-04

- 动态可重构阵列处理器数据流处理单元的设计与实现
- The Design and Implementation of Data Flow Processing Unit of Dynamical Reconfigurable Array Processor
- 微电子学与计算机 2017年34卷第1期页码：106-109
- 作者机构：
  
  西安邮电大学机构电子工程学院,陕西,西安,710121
- 作者简介：
- 基金信息：
  
  国家自然科学基金重点项目 61136002国家自然科学基金面上项目 61272120陕西省自然科学基金项目 2015JM6326
- DOI：
  中图分类号：
- 纸质出版：2017
- 稿件说明：
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山蕊, 李涛, 蒋林. 动态可重构阵列处理器数据流处理单元的设计与实现[J]. 微电子学与计算机, 2017, 34(1): 106-109.

SHAN Rui, LI Tao, JIANG Lin. The Design and Implementation of Data Flow Processing Unit of Dynamical Reconfigurable Array Processor[J]. 2017, 34(1): 106-109.
山蕊, 李涛, 蒋林. 动态可重构阵列处理器数据流处理单元的设计与实现[J]. 微电子学与计算机, 2017, 34(1): 106-109. DOI：

SHAN Rui, LI Tao, JIANG Lin. The Design and Implementation of Data Flow Processing Unit of Dynamical Reconfigurable Array Processor[J]. 2017, 34(1): 106-109. DOI：

摘要

阵列处理器是一种满足高效能需求、适应未来工艺发展的并行计算结构.基于动态可重构阵列处理器架构

提出了一种基于数据流驱动的处理单元高效硬件实现结构

并完成了四抽头低通滤波器的电路映射及仿真

最后基于Xilinx V6开发板的综合结果进行了性能分析.

Abstract

Array processor is a kind of parallel computing architecture meeting the demand of high performance and adapting the development of technology in the future.This paper proposed a kind of high efficient architecture of processing unit based of data flow driven

completed the mapping and simulation of four tap low-pass filter.Finally

performance analysis was provided according to the synthesize result based on Xilinx v6 development board.

关键词

Keywords

references

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