一种用于JESD204B协议的8B/10B并行编码电路设计与实现

王俊杰; 万书芹; 季惠才; 陶建中; 杨阳

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一种用于JESD204B协议的8B/10B并行编码电路设计与实现

更新时间：2026-09-04

- 一种用于JESD204B协议的8B/10B并行编码电路设计与实现
- Design and implementation of 8B/10B parallel coding circuit for JESD204B protocol
- 微电子学与计算机 2020年37卷第6期页码：35-39
- 作者机构：
  
  1. 江南大学物联网工程学院,江苏,无锡,214122
  2. 中国电子科技集团公司第五十八研究所,江苏,无锡,214035
- 作者简介：
- 基金信息：
  
  国家自然科学基金项目 61704161
- DOI：
  中图分类号：
- 纸质出版：2020
- 稿件说明：
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王俊杰, 万书芹, 季惠才, 陶建中, 杨阳. 一种用于JESD204B协议的8B/10B并行编码电路设计与实现[J]. 微电子学与计算机, 2020, 37(6): 35-39.

WANG Jun-jie, WAN Shu-qin, JI Hui-cai, et al. Design and implementation of 8B/10B parallel coding circuit for JESD204B protocol[J]. 2020, 37(6): 35-39.
王俊杰, 万书芹, 季惠才, 陶建中, 杨阳. 一种用于JESD204B协议的8B/10B并行编码电路设计与实现[J]. 微电子学与计算机, 2020, 37(6): 35-39. DOI：

WANG Jun-jie, WAN Shu-qin, JI Hui-cai, et al. Design and implementation of 8B/10B parallel coding circuit for JESD204B protocol[J]. 2020, 37(6): 35-39. DOI：

摘要

本文设计并实现了一种四路并行的8B/10B编码电路，通过了NCVerilog仿真验证，在某65 nm工艺库下工作频率可达405 MHz，可支持16.2 Gbps的串行数据传输速率，占用逻辑资源面积1832 m，并作为JESD204B协议中的8B/10B编码模块已应用于某高速ADC芯片的SerDes接口电路中.经实际电路测试，本设计达到了JESD204B协议标准的12.5 Gbps最高传输速率要求.

Abstract

This paper designs and implements a four-way parallel 8B/10B encoding circuit

which has been verified by NCVerilog simulation. It can work at 405 MHz under a 65-nm technology library

supporting 16.2 Gbps serial data transmission rate

occupying 1832m of logical resources. As the 8B/10B coding module in JESD204B protocol

it has been applied in the SerDes interface circuit of a high-speed ADC chip. The actual circuit test shows that the encoder meets the 12.5 Gbps maximum transmission rate requirement of JESD204B protocol standard.

关键词

Keywords

references

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