混合基可重构FFT处理器的设计与实现

宋宇鲲; 曲双双; 徐礼晗; 张多利

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混合基可重构FFT处理器的设计与实现

更新时间：2026-09-04

- 混合基可重构FFT处理器的设计与实现
- Design and implementation of mixed radix reconfigurable Fast Fourier Transform processor
- 微电子学与计算机 2020年37卷第1期页码：87-92
- 作者机构：
  
  合肥工业大学电子科学与应用物理学院,安徽,合肥,230009
- 作者简介：
- 基金信息：
  
  国家自然科学基金 61874156
- DOI：
  中图分类号：
- 纸质出版：2020
- 稿件说明：
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宋宇鲲, 曲双双, 徐礼晗, 张多利. 混合基可重构FFT处理器的设计与实现[J]. 微电子学与计算机, 2020, 37(1): 87-92, 98.

SONG Yu-kun, QU Shuang-shuang, XU Li-han, et al. Design and implementation of mixed radix reconfigurable Fast Fourier Transform processor[J]. 2020, 37(1): 87-92.
宋宇鲲, 曲双双, 徐礼晗, 张多利. 混合基可重构FFT处理器的设计与实现[J]. 微电子学与计算机, 2020, 37(1): 87-92, 98. DOI：

SONG Yu-kun, QU Shuang-shuang, XU Li-han, et al. Design and implementation of mixed radix reconfigurable Fast Fourier Transform processor[J]. 2020, 37(1): 87-92. DOI：

摘要

本文提出了一种新型混合基可重构FFT处理器，由支持基-2/3FFT的新型可重构蝶形单元和多路并行无冲突的存储器组成，实现了FFT过程中多路数据并行性和操作的连续性.本设计在TSMC28nm工艺下的最高频率为1.06GHz

同时在Xilinx的XC7V2000T FPGA芯片上搭建了混合基FFT处理器硬件测试系统.对混合基FFT处理器的FPGA硬件测试结果表明，本设计支持基-2、基-3和基-2/3混合模式FFT变换，且执行速度达到给定蝶乘器数量下的理论周期值，对单精度浮点数，混合基FFT处理器可提供10的结果精度.

Abstract

This paper presents a novel mixed radix reconfigurable FFT processor

which consists of a new reconfigurable butterfly unit supporting radix-2/3 FFT and multi-channel parallel collision-free memory

which implements multi-channel data parallelism and the continuity of the operation for FFT operation. The maximum frequency of this design is 1.06 GHz under the TSMC28nm process. At the same time

the mixed radix FFT processor hardware test system based on the Xilinxs XC7V2000T FPGA chip completes performance verification. The results shows that the design supports FFT operations for radix-2 mode

radix-3 mode and radix-2/3 mixed mode

and the execution speed reaches the theoretical period value under the given number of butterfly multipliers. For single-precision floating-point numbers

mixed radix FFT processor provides a result accuracy of 10.

关键词

Keywords

references

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